Поэтому была реализована архитектура подсистемы памяти, позволяющая командам чтения опережать команды записи и другие команды чтения. Буфер упорядочения памяти служит в качестве распределительной станции и буфера переупорядочивания. В нем хранятся отложенные команды чтения и записи, и он осуществляет их повторное диспетчирование, когда блокирующее условие (зависимость по данным или недоступность ресурсов) исчезает.

Вывод

Таким образом, реализованная в P6 комбинация таких архитектурных методов, как улучшенное предсказание переходов (почти всегда правильно определяется предстоящая последовательность команд) , анализ потоков данных (определяется оптимальный порядок выполнения команд) и опережающее выполнение (предвиденная последовательность команд выполняется без простоев в оптимальном порядке) , позволила удвоить производительность по отношению к Pentium при использовании той же самой технологии производства. Эта комбинация методов называется динамическим выполнением.

В настоящее время "Intel" ведет разработку новой 0,35 мкм технологии производства, что даст возможность выпускать процессоры P6 с тактовой частотой ядра свыше 200 МГц.

Р6 как платформа для построения мощных серверов.

Среди наиболее значимых тенденций развития компьютеров в последние годы можно выделить как все возрастающее использование систем на основе процессоров семейства х86 в качестве серверов приложений, так и растущую роль "Intel" как поставщика непроцессорных технологий, таких как шины, сетевые технологии, сжатие видеоизображений, флэш-память и средства системного администрирования.

Выпуск процессора Р6 продолжает проводимую "Intel" политику переноса возможностей, которыми ранее обладали лишь более дорогие компьютеры, на массовый рынок. Для внутренних регистров Р6 предусмотрен контроль по четности, а соединяющая ядро процессора и кэш второго уровня 64-битовая шина оснащена средствами обнаружения и исправления ошибок. Встроенные в Р6 новые возможности диагностики позволяют производителям проектировать более надежные системы. В Р6 предусмотрена возможность получения через контакты процессора или с помощью программного обеспечения информации о более чем 100 переменных процессора или происходящих в нем событиях, таких как отсутствие данных в кэше, содержимое регистров, появление самомодифицирующего кода и так далее. Операционная система и другие программы могут считывать эту информацию для определения состояния процессора. В Р6 также реализована улучшенная поддержка контрольных точек, то есть обеспечивается возможность отката компьютера в зафиксированное ранее состояние в случае возникновения ошибки.

Р6 поддерживает те же возможности по контролю при помощи функциональной избыточности (FRC) , что и Pentium. Это означает, что в P6 предусмотрена возможность построения систем с параллельным выполнением одних и тех же операций двумя процессорами с взаимным контролем результатов и сообщением об ошибке в случае расхождения. При этом, к сожалению, P6 по-прежнему не сообщает о причине ошибки.

В модели Р54С процессора Pentium "Intel" предложила простой и недорогой способ организации двухпроцессорной работы: ведущий и ведомый процессоры используют общий кэш и невидимо для приложений разделяют программу на потоки. Однако использовать такую организацию работы могут лишь многопоточные операционные системы.

Р6 переводит организацию многопроцессорной работы на новый уровень, соответствующий определенной "Intel" мультипроцессорной спецификации MPS 1.1. Одним из наиболее сложных аспектов симметричной многопроцессорной работы является поддержание кэш-соответствия для всех подсоединенных к отдельным процессорам кэшей.

Р6 поддерживает кэш-соответствие для вторичного кэша на внутреннем уровне, а внешняя шина P6 выступает как симметричная мультипроцессорная шина.

Раньше проектировщики мультипроцессорных систем должны были создавать собственные шины для связи процессоров, либо приобретать лицензию на уже существующие решения, например Corollary C-bus II. Теперь средства, реализованные "Intel" в Р6, позволяют объединить четыре процессора в мультипроцессорную систему. Четыре - это предел, обуславливаемый принятой в Р6 логикой арбитража.

Еще одна проблема для производителей многопроцессорных систем на базе Р6 состоит в том, что для эффективной работы таких систем к каждому процессору подключается выделенный кэш, размер которого должен быть больше, чем 256 кб - размер кэша в корпусе Р6. Таким образом, проектировщики высокопроизводительных серверов будут вынуждены использовать внешние контроллеры кэша и дополнительные микросхемы статической памяти.

Эта проблема будет разрешена, если "Intel" увеличит размер кэша второго уровня в корпусе Р6, что достижимо либо за счет увеличения размера кристалла, либо за счет перехода к более миниатюрной технологии производства. Сегодня производители, которые хотят строить системы с более чем четырьмя процессорами, должны объединять две или более четырехпроцессорных системы с помощью высокоскоростного последовательного соединения память-память. Реализации таких соединений для PCI ожидаются в этом году.